Texas Instruments MSP430x1xx User Manual

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Figures

xvi

14–15 Timing for Measuring a Current Source

14-18

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14–16 A/D Converter for Voltage Sources

14-19

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14–17 A/D Converter for Voltage Sources, Conversion Timing

14-19

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14–18 Measuring the Offset Voltage of the Comparator, CAEX = 0

14-20

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14–19 Offset Voltage of the Comparator, CAEX = 0

14-20

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

14–20 Measuring the Offset Voltage of the Comparator, CAEX = 1

14-21

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14–21 Offset Voltage of the Comparator, CAEX = 1

14-21

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14–22 Use CAOUT at an External Pin to Add Hysteresis to the Reference Level

14-23

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15–1

ADC12 Schematic

15-2

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15–2

ADC Core, Input Multiplexer, and Sample-and-Hold

15-4

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15–3

Analog Multiplexer Channel

15-6

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15–4

Stopping Conversion With ENC Bit

15-10

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15–5

Single-Channel, Single-Conversion Mode

15-11

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15–6

Example Conversion-Memory Setup

15-12

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15–7

ENC Does Not Effect Active Sequence

15-13

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15–8

Sequence-of-Channels Mode

15-14

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15–9

Sequence-of-Channels Mode Flow

15-15

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15–10 Sequence-of-Channels Mode Example

15-16

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15–11 Repeat-Single-Channel Mode

15-17

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15–12 Repeat-Sequence-of-Channels Mode

15-19

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15–13 The Conversion Clock ADC12CLK

15-21

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15–14 The Sample-and-Hold Function

15-22

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15–15 Sample and Conversion, Basic Signal Timing

15-23

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15–16 Synchronized Sample and Conversion Signal With Enable Conversion

15-24

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15–17 Conversion Timing, Pulse-Sample Mode

15-25

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15–18 Pulse-Sample Mode Example Configuration

15-25

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15–19 Pulse-Sample Mode Example Timing

15-26

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15–20 Conversion Timing for Extended-Sample Mode

15-26

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15–21 Extended-Sample Mode Example Configuration

15-27

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15–22 Extended-Sample Mode Example Timing

15-27

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15–23 Use of MSC Bit With Nonrepeated Modes

15-28

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15–24 Use of MSC Bit With Repeated Modes

15-28

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15–25 Equivalent Circuit

15-29

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15–26 A/D Grounding and Noise Considerations

15-41

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B–1

Double-Operand Instructions

B-4

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B–2

Single-Operand Instructions

B-5

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B–3

Conditional and Unconditional Jump Instructions

B-5

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

B–4

Decrement Overlap

B-26

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

B–5

Main Program Interrupt

B-46

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

B–6

Destination Operand—Arithmetic Shift Left

B-47

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B–7

Destination Operand—Carry Left Shift

B-48

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B–8

Destination Operand—Arithmetic Right Shift

B-49

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

B–9

Destination Operand—Carry Right Shift

B-51

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B–10

Destination Operand Byte Swap

B-58

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

B–11

Destination Operand Sign Extension

B-59

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C–1

Interconnection of Flash Memory Module(s)

C-2

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–2

Flash Memory Module1 Disabled, Module2 Can Execute Code
Simultaneously

C-3

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C–3

Flash Memory Module Example

C-4

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

C–4

Segments in Flash Memory Module, 4K-Byte Example

C-5

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C–5

Flash Memory Module Block Diagram

C-6

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

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